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3.3.2 设计输入教学视频在线视频

下一节:3.3.4 设计输入讨论

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3.3.2 设计输入教学视频课程教案、知识点、字幕

同学们，大家好

上一讲我们讲解了

如何在Quartus Ⅱ软件中新建工程

那么本讲我们将学习

电路的设计与实现中的第二步

——设计输入

首先介绍一下设计输入文件的分类

在新建工程之后

要做的就是输入设计文件

设计输入文件有两种

分别为原理图和硬件描述语言文本

原理图是利用逻辑图形符号

来描述电路的逻辑功能

硬件描述语言文本

是利用硬件描述语言来描述电路的逻辑功能

大家可根据设计需要自行选择

由于硬件描述语言的相关知识还没有学习

这里便以原理图输入为例进行讲解

首先双击打开Quartus Ⅱ软件

点击“文件”菜单，选择“打开”选项

找到工程保存路径

选择文件类型为“工程文件”

选中工程，点击“打开”

此时“工程向导窗口”

会显示上一讲中新建的工程

1位全加器

第二种打开方法是

点击“文件”菜单下的“最近的工程”选项

即可打开最近编辑过的工程

这里要强调的是

打开的文件一定是工程文件

后缀为“qpf”

首先创建原理图文件

点击“文件”菜单下的“新建”选项

在对话框中选择

“方块图/原理图”文件选项

若创建硬件描述语言文件

则选择“VHDL文件“

或”Verilog HDL文件“即可

点击“确定”

主界面会出现原理图编辑器窗口

接下来点击”文件“中的”另存为“选项

将其保存在工程所在文件夹下

文件名默认与工程名一致

也可修改为想要的名称，点击“保存”

为了方便画图

建议大家将图纸设置为带有网点的形式

设置方法为：在图纸处点击右键

选择”显示”选项

选中“显示辅助线”即可

这些网点便于元件的布局与连线

在绘制原理图之前

首先介绍工具栏中的一些常用工具

在图纸的上方

有一个便于绘制原理图的工具栏

下面介绍几个常用工具

最左侧的按钮

功能是将原理图编辑器窗口在主窗口外打开

点击该按钮

原理图编辑器便移出了主窗口

当原理图中元件较多或连线复杂时

通过移出主窗口，更便于原理图的绘制

第二个按钮的功能是用于选中元件或导线

第三个按钮的功能是用于放大、缩小图纸

第四个按钮的功能是通过鼠标拖动图纸的位置

第五个按钮的功能是在图纸中标注文本

第六个按钮的功能是用于选择放置元器件

第七个按钮的功能是选择放置输入、输出管脚

其他按钮在使用时再做详细介绍

以上便是一些常用的工具

接下来，我们介绍一下

如何在图纸中插入一个元器件

点击工具栏中的“符号工具”按钮

在弹出的对话框的左上角

显示了软件自带的元件库

第一个为宏功能库

又分为I/O模块库、算术运算模块库

逻辑门库、存储器库

第二个为其它元件库

主要包括74系列数字集成电路模块

第三个为基本元件库

又分为缓冲器、逻辑门

其他功能模块、引脚和存储器

这里我们选择放置一个简单的2输入与门

选择“基本元件库”下面的

逻辑门子库中的“and2”

也可在“名称”空白处直接输入元件名称

可快速定位所需元件

这里需要注意

如果想要连续输入多个相同的元件

选中“重复插入模式”

即可实现连续放置

点击“确定”

所选择的符号

便出现在原理图编辑器工作区域

单击一次鼠标左键，便可实现一次放置

若想取消连续放置

单击工具栏的“选择工具”

或键盘上的“ESC”按钮即可

想要构成一个完整的电路

必须包含输入、输出管脚

我们用上述方法将其插入到原理图

点击“符号工具”

在对话框中输入“input”

点击“确定”，连续放置多个输入管脚

重复上述步骤，插入一个输出管脚

在插入输入、输出管脚时

也可通过工具栏中的按钮快速实现

我们将2输入与门所需的元件

摆放至合适的位置

同时删除多余元件

可通过工具栏中的“放大/缩小工具”

来对图纸中的任何位置进行放大、缩小

也可通过CTRL+鼠标滚轴实现

接下来的工作便是进行电路连接

将鼠标移至需要连接导线的位置

便会出现“直角连线工具”图标

点击鼠标左键

并拖动至与门的一个输入端

当出现一个方框的标志时

表示已连接至端口处

松开左键即可完成连接

这里还可通过

点击工具栏中的“直角连线工具”

进行电路连接

我们用上述方法连接其他管脚

下一步是修改管脚名称

通过双击“pin_name”

或双击管脚图形符号输入预设名称

点击“确定”，完成修改

用上述方法修改其他管脚

此时一个2输入与门电路便绘制完成

按照上述原理图绘制方法

我们来绘制1位全加器的电路

这里直接向大家展示一个绘制完成的原理图

此电路便是依据

1位全加器的逻辑功能绘制的原理图

输入端为两个加数

A、B以及来自低位的进位Cin

A、B、Cin相加的结果需要两个输出端实现

一个是本位和——S

另一个是向高位的进位——Cout

这里需要说明原理图并不是唯一的

只要其满足逻辑功能即可

大家可以根据自己的设计进行输入

检查无误后点击“保存”

便实现了1位全加器的电路输入

以上就是关于设计输入的

所有操作步骤及注意事项

本讲到这里就结束了

下一讲将会介绍如何进行设计编译

同学们，再见

EDA技术与应用课程列表：

第一章 EDA技术概述

-1.1 EDA技术概述

--1.1.1 EDA技术概述导学

--1.1.2 EDA技术概述教学视频

--1.1.3 EDA技术概述单元测验

--1.1.4 EDA技术概述讨论

第二章可编程逻辑器件概述

-2.1 可编程逻辑器件（PLD）概述

--2.1.1 可编程逻辑器件导学

--2.1.2 可编程逻辑器件概述教学视频

--2.1.3 可编程逻辑器件概述单元测验

--2.1.4 可编程逻辑器件概述讨论

-2.2 CPLD的结构和原理

--2.2.1 CPLD结构和原理导学

--2.2.2 CPLD的结构和原理教学视频

--2.2.3 CPLD的结构和原理单元测验

--2.2.4 CPLD的结构和原理讨论

-2.3 FPGA的结构和原理

--2.3.1 FPGA的结构和原理导学

--2.3.2 FPGA的结构和原理教学视频

--2.3.3 FPGA的结构和原理单元测验

--2.3.4 FPGA的结构和原理讨论

-2.4 FPGA和CPLD的选用

--2.4.1 FPGA和CPLD的选用导学

--2.4.2 FPGA和CPLD的选用教学视频

--2.4.3 FPGA和CPLD的选用单元测验

--2.4.4 FPGA和CPLD的选用讨论

-2.5 FPGA与CPLD的编程和配置

--2.5.1 FPGA与CPLD的编程与配置导学

--2.5.2 FPGA与CPLD的编程与配置教学视频

--2.5.3 FPGA与CPLD的编程与配置单元测验

--2.5.4 FPGA与CPLD的编程与配置讨论

第三章 EDA开发平台——QuartusII应用

-3.1 QuartusII概述

--3.1.1 Quartus Ⅱ概述导学

--3.1.2 Quartus Ⅱ概述教学视频

--3.1.3 Quartus Ⅱ概述单元测验

--3.1.4 Quartus Ⅱ概述讨论

-3.2 新建工程

--3.2.1 新建工程导学

--3.2.2 新建工程教学视频

--3.2.3 新建工程单元测验

-3.3 设计输入

--3.3.1 设计输入导学

--3.3.2 设计输入教学视频

--3.3.3 设计输入单元测验

--3.3.4 设计输入讨论

-3.4 设计编译

--3.4.1 设计编译导学

--3.4.2 设计编译教学视频

--3.4.3 设计编译单元测验

--3.4.4 设计编译讨论

-3.5 仿真验证

--3.5.1 仿真验证导学

--3.5.2 仿真验证教学视频

--3.5.3 仿真验证单元测验

--3.5.4 仿真验证讨论

-3.6 器件编程

--3.6.1 器件编程导学

--3.6.2 器件编程1 教学视频

--3.6.3 器件编程2 教学视频

--3.6.4 器件编程单元测验

--3.6.5 器件编程讨论

-3.7层次化设计

--3.7.1 层次化设计导学

--3.7.2 层次化设计教学视频

--3.7.3 层次化设计单元测验

--3.7.4 层次化设计讨论

-3.8 宏功能模块的使用

--3.8.1 宏功能模块的使用导学

--3.8.2 宏功能模块的使用教学视频

--3.8.3 宏功能模块的使用单元测验

--3.8.4 宏功能模块的使用讨论

第四章 VHDL语言概述

-4.1 VHDL语言概述

--4.1.1 VHDL概述导学

--4.1.2 VHDL语言概述教学视频

--4.1.3 VHDL语言概述单元测验

--4.1.4 VHDL概述讨论

-4.2 VHDL代码的结构

--4.2.1 VHDL代码的结构导学

--4.2.2 VHDL代码的结构教学视频

--4.2.3 VHDL代码的结构单元测验

--4.2.4 VHDL代码的结构讨论

-4.3 库和库声明

--4.3.1 库和库声明导学

--4.3.2 库和库声明教学视频

--4.3.3 库和库声明单元测验

--4.3.4库和库声明讨论

-4.4 实体说明

--4.4.1 实体说明导学

--4.4.2 实体说明教学视频

--4.4.3 实体说明单元测验

--4.4.4 实体说明讨论

-4.5 结构体

--4.5.1 结构体导学

--4.5.2 结构体教学视频

--4.5.3 结构体单元测验

--4.5.3 结构体讨论

-4.6 VHDL预定义数据类型

--4.6.1 VHDL预定义数据类型导学

--4.6.2 VHDL预定义数据类型教学视频

--4.6.3 VHDL预定义数据类型单元测验

--4.6.4 VHDL预定义数据类型讨论

-4.7 常量、变量和信号

--4.7.1 常量、变量和信号导学

--4.7.2 常量、变量和信号教学视频

--4.7.3 常量、变量和信号单元测验

--4.7.4 常量、变量和信号讨论

-4.8 运算操作符和属性

--4.8.1 运算操作符和属性导学

--4.8.2 运算操作符和属性教学视频

--4.8.3 运算操作符和属性单元测验

--4.8.4 运算操作符和属性讨论

-4.9 IF语句和WAIT语句

--4.9.1 IF语句和WAIT语句导学

--4.9.2 IF语句和WAIT语句教学视频

--4.9.3 IF语句和WAIT语句单元测验

--4.9.4 IF语句和WAIT语句讨论

-4.10 CASE语句

--4.10.1 CASE语句导学

--4.10.2 CASE语句教学视频

--4.10.3 CASE语句单元测验

--4.10.4 CASE语句讨论

-4.11 LOOP循环语句

--4.11.1 LOOP循环语句导学

--4.11.2 LOOP循环语句教学视频

--4.11.3 LOOP循环语句单元测验

--4.11.4 LOOP循环语句讨论

-4.12 进程

--4.12.1 进程导学

--4.12.2 进程教学视频

--4.12.3 进程单元测验

--4.12.4 进程讨论

-4.13 条件信号赋值语句

--4.13.1 条件信号赋值语句导学

--4.13.2 条件信号赋值语句教学视频

--4.13.3 条件信号赋值语句单元测验

-4.14 选择信号赋值语句

--4.14.1 选择信号赋值语句导学

--4.14.2 选择信号赋值语句教学视频

--4.14.3 选择信号赋值语句单元测验

-4.15 元件例化语句

--4.15.1 元件例化语句导学

--4.15.2 元件例化语句教学视频

--4.15.3 元件例化语句单元测验

--4.15.4 元件例化语句讨论

-4.16 VHDL模块化设计

--4.16.1 VHDL模块化设计

--4.16.2 VHDL模块化设计教学视频

--4.16.3 VHDL模块化设计单元测验

--4.16.4 VHDL模块化设计讨论

第五章设计方法概述

-5.1 设计方法概述

--5.1.1 设计方法概述导学

--5.1.2 设计方法概述教学视频

--5.1.3 设计方法概述单元测验

--5.1.4 设计方法概述讨论

-5.2 EDA综合设计案例(1）— 数字钟的设计

--5.2.1 EDA综合设计案例1 导学

--5.2.2 EDA综合设计设计案例1— 数字钟的设计教学视频

--5.2.3 EDA综合设计案例1 单元测验

--5.2.4 EDA综合设计案例1 讨论

-5.3 EDA综合设计案例（2）—16×16点阵控制器设计

--5.3.1 EDA综合设计案例2 导学

--5.3.2 EDA综合设计案例2—16×16点阵控制器设计教学视频

--5.3.3 EDA综合设计案例2 单元测验

--5.3.4 EDA综合设计案例2 讨论

思政教育

-国产EDA技术如何突破？

3.3.2 设计输入教学视频笔记与讨论

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