当前课程知识点：数字电子技术基础 > 第六周 > 4.3-3-1 数据选择器 > Video
下面我们介绍另一种
中规模集中电路
叫数据选择器
那么什么是数据选择器呢
实际上就是我们对于输入
从一组的数据输入中
来选择一种进行输出
也就是说我们可能输入当中
可能有多个输入
但是我们在输出的时候
我们可以选择一下
到底让哪一个输入
去输出出去
那么这就是数据选择器
有的时候呢
我们也把它叫多路开关
相当于我们每一个输入
我们都有一个开关
那么这个开关来决定
哪一个输入能够到输出去
所以简单的讲
它的工作原理
就是从一组输入数据中
选择某一个来进行输出
这里显示了一个电路
是双四选一的一个芯片
叫74HC153
那么实际上我们只要看
其中的一个就可以了
也就是其中的一个四选一
那么大家来看看这个电路
所谓四选一也就是说
我们对于一个四选一的部分来讲
我们有四个输入
比如D1 D0 D1 D2 D3
那么这个时候
我通过我的选择
只让其中的某一个
能够通过Y输出出去
那它是什么一个原理呢
实际上我们是在这个电路的内部
加了很多的开关
那么这个开关来决定
到底哪一个数据能够输入
输出出去
比如这个开关
由我们另外一个
两个输入端A0 A1来控制
比如我们希望D0能够输出出去
那么D0要输出出去的话
那么怎么能够才实现这个目的呢
我们可以看到
我们如果让A0等于0
A1等于0
A0等于0的话
经过一个反相器以后
那么实际上呢TG1就打开了
TG1相当于一个开关 对吧
那么TG1打开了以后
D0的信号经过TG1
就可以进入到下一个TG5
那么TG5呢
又是由A1来控制
那么如果A1是0的时候
它经过一个反相器变成了1了以后
又把TG5打开
那么这个时候D0
就可以从Y1输出出去了
由此可以看到D0 D1 D2 D3
能否输出 谁输出
则是由AO和A1来控制的
我们对于这个工作原理
也可以用一个函数式来表达
比如对于上面的这个四选一来讲
如果我们这里有一个S1
这是（选终端）我们不去讲了
如果把它加进来的话
那么这个函数表达式
就是Y1等于S1括号
里面每一个A1
A0’A1’或者A0 A1’
或者AO’A1 或者A0 A1
都是来决定某一个D0 D1 D2 D3
谁能够输出出去
而这个A0 A1我们可以看到
它就是一个选通的
一个开关的一个数码
来决定到底哪一个数字输出出去
那么具体的我们也可以
下面这个表也可以看的出来
S1’如果选通的时候
那么由A0和A1来选择
那么当A0 A1都是0的时候
那么D0出去
A0 A1当中呢 是1 0
那么D1出去
这样的话我们就可以看到
这个工作的原理
基本上就是这样的
而对于两个芯片来讲呢
对于两个四选一来讲
做在一个芯片里的来讲
无非我们就是加上两个选通
一个是S1’一个是S2’
那么这两个你选通了哪一个
那么哪一个部分
四选一的部分能够工作
你选择另外一个
那么另外一个四选一的能够工作
所以这是一个双四选一的
74HC153的一个工作原理
好 那么我们有了双四选一的
两个双四选一的芯片以后
很自然的就是
我能不能把它变成八选一呢
就是它两个双四选一分别工作
改成它统一的一起工作
这样的话我八个里头选择一个
其实这个事情非常的简单
我们可以看到四选一
只有两位的（地址）输入
从四个里选一个
我要变成八选一呢
我就要 需要有三个
三位的地址代码
来决定其中哪一个输入
那么好 第三位的地址
我们就可以去选终端
S1’和S2’来决定
所以这写到了利用S’
作为第三位的地址的输入端
那么它如何去工作呢
很简单
那么对于A2
我们作为第三位的这个地址来讲
它一个直接接S1’
另外呢经过一个反相器来接S2’
也就是意味着
如果比如说A2是0的时候
那么上面的这个四选一工作
如果A2是1的时候呢
下面的四选一工作
根据这个原理
我们就很容易写出
下面的这个表达式
这样我们就用两个四选一
可以接成八选一的
一个数据选择器
-0.1 数字量和模拟量
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-0.2 电子技术的发展历程
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-0.3 课程的基本任务
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-1.1 信息与编码
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-1.2 二进制的补码
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-1.3 二进制补码运算的符号位
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-1.4 二进制的编码
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-1.5 用电压来表达信息
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-1.6 电压信号的离散化
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-2.1 逻辑代数概述
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-2.2 逻辑代数的三种基本运算
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-第一周--第一周作业
-2.3 几种常用的复合逻辑运算
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-2.4 逻辑代数的基本公式和常用公式
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-2.5 逻辑代数的基本定理
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-2.6 逻辑函数及其表示方法
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-2.7 逻辑函数形式的变换
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-2.8 逻辑函数的化简
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-2.9 逻辑函数的最小项之和
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-2.10 逻辑函数的最大项之积
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-2.11 最小项和最大项的关系
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-2.12 逻辑函数的卡诺图
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-2.13 卡诺图化简法
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-2.14 具有无关项的逻辑函数及其化简
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-2.15 逻辑函数的机器化化简法
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-第二周--第二周作业
-3.0 门电路概述
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-3.1-1 半导体二极管的开关特性
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-3.1-2 二极管与门
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-3.1-3 二极管或门
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-3.1-4 二极管门电路的缺点
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-3.2-1 MOS管的基本构造和工作原理
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-3.2-2 MOS管的开关特性
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-3.2-3 MOS管的工作特性曲线
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-3.3-1 CMOS反相器的电路结构和工作原理
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-3.3-2 CMOS反相器的电压电流传输特性
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-3.3-3 CMOS反相器的静态输入输出特性
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-3.3-4 CMOS反相器的动态特性
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-3.3-5 CMOS反相器的总功耗
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-第三周--第三周作业
-3.4-1 其他逻辑功能的CMOS门电路
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-3.4-2 带缓冲级的CMOS门电路
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-3.4-3 漏极开路的门电路
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-3.4-4 CMOS传输门和三态门
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-3.5-1-1 双极型三极管的输入输出特性
--Video
-3.5-1-2 双极型三极管的基本开关电路
--Video
-3.5-1-3 双极型三极管的开关等效电路、三极管反相器
--Video
-第四周--第四周作业
-3.5-2-1 TTL反相器的电路结构
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-3.5-2-2 TTL反相器的工作原理
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-3.5-2-3 TTL反相器中的几个 问题和输入噪声容限
--Video
-3.5-3-1 TTL反相器的输入输出特性
--Video
-3.5-3-2 TTL反相器的输入端负载特性
--Video
-3.5-3-3 TTL反相器的扇出系数
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-3.5-4-1 TTL反相器的传输延迟时间
--Video
-3.5-4-2 TTL反相器的交流噪声容限
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-3.5-4-3 电源的动态尖峰电流
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-3.5-5-1 其他逻辑功能的TTL门电路
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-3.5-5-2 集电极开路输出的门电路
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-3.5-5-3 三态输出门
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-实验一：与非门电压传输特性曲线的观测
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-实验二：与非门传输延迟时间的测量
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-第五周--第五周作业
-4.1 组合逻辑电路的特点
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-4.2-1 组合逻辑电路的分析方法
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-4.2-2 组合逻辑电路的设计方法
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-4.3-1-1 若干常用组合逻辑电路：普通编码器
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-4.3-1-2-1 优先编码器
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-4.3-1-2-2 优先编码器的扩展
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-4.3-1-3 二-十进制优先编码器
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-4.3-2-1 译码器
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-4.3-2-2 二进制译码器的扩展
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-4.3-2-3-1 显示译码器
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-4.3-2-3-2 显示译码器附加控制端的作用
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-4.3-2-4 用译码器设计组合逻辑电路
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-4.3-3-1 数据选择器
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-4.3-3-2 用数据选择器设计组合电路
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-4.3-4-1 加法器
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-4.3-4-2 多位加法器
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-4.3-4-3 用加法器设计组合电路
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-4.3-5 数值比较器
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-4.4-1_4.4-2 组合逻辑电路中的竞争-冒险现象
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-4.4-3 消除竞争-冒险现象的方法
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-第六周--第六周作业
-4.5 可编程器件及EDA1
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-5.0 触发器的由来
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-5.1 门电路与触发器的关系
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-5.2 基本RS锁存器
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-5.3-1 电平触发的SR触发器
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-5.3-2 电平触发的D触发器1
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-5.3-3 电平触发的D触发器2
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-5.4-1-1 脉冲触发的触发器--主从D触发器
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-5.4-1-2 脉冲触发的触发器--主从SR触发器
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-5.4-1-3 脉冲触发的触发器--主从JK触发器
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-5.4-2 脉冲触发方式的动作特点
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-5.5 边沿触发的触发器
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-5.6-1 触发器的逻辑功能及其描述方法--SR触发器
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-5.6-2触发器的逻辑功能及其描述方法--JK触发器、T触发器、D触发器
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-第七周--第七周作业
-5.7-1 触发器的动态特性1
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-5.7-2 触发器的动态特性2
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-5.7-3 触发器的动态特性3
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-6.1-1 时序逻辑电路概述
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-6.1-2 时序电路的一般结构形式与功能描述方法
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-6.1.3 时序电路的分类
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-6.2.1-1 同步时序电路的分析方法1
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-6.2.1-2 同步时序电路的分析方法2
--Video
-6.2.3 异步时序电路的分析方法
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-6.3.1-1 寄存器
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-6.3.1-2 移位寄存器1
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-6.3.1-3 移位寄存器2
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-6.3.1-4 移位寄存器扩展应用
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-6.3.2-1-1-1 计数器概述、同步二进制加法计数器
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-6.3.2-1-1-2 同步二进制减法计数器
--Video
-6.3.2-1-1-3 同步加减计数器
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-6.3.2-1-2-1 同步十进制加法计数器
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-6.3.2-1-2-2 同步十进制减法计数器、十进制可逆计数器
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-6.3.2-2 异步计数器
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-第八周--第八周作业
-6.3.2-3-1-1 任意进制计数器的构成方法
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-6.3.2-3-1-2 任意进制计数器的构成方法--举例(N>M)
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-6.3.2-3-1-3 任意进制计数器的构成方法--举例(N<M)
--Video
-6.3.2-4 计数器应用举例
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-6.4.1-1 时序逻辑电路的设计方法
--Video
-6.4.1-2 时序逻辑电路的设计方法--举例
--Video
-6.4.2 时序逻辑电路的动态特性分析
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-7.0 半导体存储器绪论
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-7.1 半导体存储器概述和分类
--Video
-7.2-1 ROM的结构和工作原理
--Video
-7.2-2 可编程ROM1
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-7.2-3 可编程ROM2
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-7.3 RAM的结构和工作原理
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-7.4-1 存储器容量的扩展-位扩展
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-7.4-2 存储器容量的扩展-字扩展
--Video
-7.5 用存储器实现组合逻辑电路
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-第九周--第九周作业
-8.1 可编程逻辑器件概述
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-8.2-8.3-8.4 可编程逻辑器件-FPLA/PAL/GAL
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-8.5-8.6-8.7 可编程逻辑器件-EPLD/CPLD/FPGA
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-8.8-8.9 可编程逻辑器件-ISPGDS、PLD的使用
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-10.1-1 脉冲波形的产生和整形概述
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-10.1-2-10.2.1 门电路组成的施密特触发器
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-10.2.2 集成施密特触发器
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-10.2.3 施密特触发器的主要特点和应用
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-10.3.1-1-1 积分型单稳态触发器--结构和工作原理
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-10.3.1-1-2 积分型单稳态触发器--性能参数计算
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-10.3.1-2-1 微分型单稳态触发器--结构和工作原理
--Video
-10.3.1-2-2 微分型单稳态触发器--性能参数计算
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-10.3.2 集成单稳态触发器
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-10.4.1 用施密特触发器构成的多谐振荡器
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-10.4.2 对称式多谐振荡器
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-10.4.3 非对称式多谐振荡器
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-第十周--第十周作业
-10.4.4 环形振荡器
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-10.4.5 石英晶体多谐振荡器
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-10.5 脉冲电路的分析方法
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-10.6.1 555定时器电路的结构与功能
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-10.6.2 用555定时器接成施密特触发器
--Video
-10.6.3 用556定时器接成单稳态触发器
--Video
-10.6.4 用557定时器接成多谐振荡器
--Video
-11.1 数模和模数转换概述
--Video
-11.2.1 权电阻网络D/A转换器
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-11.2.2 倒T型电阻网络D/A转换器
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-11.2.3 具有双极性输出的电阻网络D/A转换器
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-11.2.4 D/A转换器的转换精度和速度
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-11.3.1 A/D转换的基本原理
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-11.3.2 采样保持电路
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-11.3.3 并联比较型A/D转换器
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-11.3.4-1 反馈比较型A/D转换器--计数型
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-11.3.4-2 反馈比较型A/D转换器--逐次渐进型
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-11.3.5 双积分型和V-F型A/D转换器
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-第十一周--第十一周作业
-I-概述、电路设计及功能仿真
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-II-指定芯片及时序仿真
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-III-选外设（自动化）、锁定引脚并生成下载文件
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-IV-电路扩展设计
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-V-用Verilog描述状态机电路
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