当前课程知识点：数字电子技术基础 > 第十周 > 10.2.3 施密特触发器的主要特点和应用 > Video
施密特触发器的主要特点
先明确一下
施密特触发器当中的
这个触发器
是有别于第五章当中
提到的触发器
第五章当中提出触发器的时候
它的用途是（00：15英文）
是用于存储一位的0 1
我们是从那儿构建的
那么施密特触发器的主要特点
是什么呢
首先施密特触发器是一个特性
这个特性是寄生在我们前面讲的
某一个逻辑门电路上的
那么如果说这个逻辑器件
具备施密特特性的话
就意味着输入信号
在上升和下降的过程当中
使得电路状态发生转换的
这个门槛值
也就是输入电平是不同的
那么在电压传输特性曲线上
表达出来就是
它一定存在这样的掷还
这是第一个
第二个施密特触发器特性
它要求在电路转换的时候
伴有正反馈
如果说在电路转换的时候
伴有正反馈
那它会使得输出的
波形边沿变陡
因此如果我们把一个具有
施密特特性的
这么一个逻辑器件
作为我的最后一级输出的话
那你得到的这个离散的
高低电平质量就会比较好
而且在高低电平转换时候的
那个斜率会比较陡
施密特触发器的应用
结合前边我们说到的
施密特触发器它就是
具有施密特特性的
某一个逻辑器件的话
那么它的应用
多半用于脉冲电路的整形
或者是变换
我们先看第一个
第一个例子当中
如果我现在有一个
具有施密特特性的
这么一个反相器
就是一个门电路
那么在输入端加入正弦信号的话
我想问输出是什么样的波形
由于施密特特性
它是说输入在上升变化
和下降变化过程当中
遇到的门槛电压不同
所以大家看
我在画这个波形的时候
我在正弦波上
也就是在我的输入信号上
我画了两个门槛电压
当我的输入和门槛电压
有交点的时候
就意味着我的输出
会发生变化了
那根据这样的分析
我们看到这是一个
施密特特性的反相器
所以当输入电平是低电平的时候
当输入电平是低电平的时候
我的输出应该是高电平
当我的输入往上变化过程当中
遇到VT正的时候
它会推动我的输出
从高电平变到低电平
由此当你分析这个波形的时候
你所关注的是
凡是VI上升变化过程当中
只看与VT正的交点
VI下降过程当中
只看与VT负的交点
那么这两个交点垂直对下来
对于你的输出来讲
就分别是高电平变低电平
和低电平高电平的
一个转换的关键点
由于施密特特性的反相器
它的输出边沿很陡
所以你输入信号
这种线性的变化
在我这儿就被屏蔽掉了
就得到了一个从正弦波
变换成为一个理想方波的
这么一个途径
第二个施密特特性的器件
用于（监伏）
我们把这个施密特特性的反相器
作为一个监伏器件的话
我们可以看到在输入信号当中
加入这样连续的电压波形
这样连续的电压波形
加在这个输入之后
它的输出是什么
我们还是通过刚才讲的方法
把你这个施密特特性的
反相器的VT正 VT负
在电压波形当中画出交点
你所关注的
只是输出信号如果正向变化
与VT正有交点的部分
也就是（超限伏）的部分
如果超限伏了
那我的输出会从高电平
变为低电平
一旦你落回来
与VT负有交点了
那么我的脉冲
就会又再回到高电平
当你再一次和VT正有交点的时候
我再次出现这个负的脉宽
依此类推
从这个变换
我们就可以通过数下边的这个
出现的低电平的脉冲个数
知道我上边的连续变化波形
到底出现了几次
超过限伏的情况
这是我们说用施密特特性的
反相器来用于监伏
还可以做的一件事情
就是脉冲整形
如果现在我有这样一个波形
大家看这个波形
是我们经常在电路分析当中
充放电的一个典型波形
如果有了充放电的
这么一个周期性的波形
我想得到一个脉冲理想的方波
一样 我把这个波形
加在具有施密特特性的反相器上
或者是具有施密特特性的
缓冲器上
都可以
现在加在反相器上的话
同样分析方法
你可以把你的VT正 VT负
两条门槛电压
画在你输入信号上
然后找到相应的VT正
和上升的这个波形的交点
和波形下降的时候
与VT负的交点
然后来界定你输出信号的变化
就也可以得到这样一个
理想的方波
除此之外我们经常还会
得到的波形会有这样的波形
也就是在我波形输出的时候
在我的上边和下边
会有一些干扰和抖动
那如果我把这样的一些信号
加在具有施密特特性的反相器上
由于我这些变化都是在我
VT正 或者VT负之下在变化
所以我的施密特特性的反相器
会屏蔽掉你这样的变化
而且由于我施密特反相器的正反馈
使得我的边沿比较好的话
那我会把你的波形
把这个不太好的这个
上升沿和下降沿
也整理成具有较陡的
上升沿和下降沿
这样的一个方波
-0.1 数字量和模拟量
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-0.2 电子技术的发展历程
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-0.3 课程的基本任务
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-1.1 信息与编码
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-1.2 二进制的补码
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-1.3 二进制补码运算的符号位
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-1.4 二进制的编码
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-1.5 用电压来表达信息
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-1.6 电压信号的离散化
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-2.1 逻辑代数概述
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-2.2 逻辑代数的三种基本运算
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-第一周--第一周作业
-2.3 几种常用的复合逻辑运算
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-2.4 逻辑代数的基本公式和常用公式
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-2.5 逻辑代数的基本定理
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-2.6 逻辑函数及其表示方法
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-2.7 逻辑函数形式的变换
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-2.8 逻辑函数的化简
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-2.9 逻辑函数的最小项之和
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-2.10 逻辑函数的最大项之积
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-2.11 最小项和最大项的关系
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-2.12 逻辑函数的卡诺图
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-2.13 卡诺图化简法
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-2.14 具有无关项的逻辑函数及其化简
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-2.15 逻辑函数的机器化化简法
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-第二周--第二周作业
-3.0 门电路概述
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-3.1-1 半导体二极管的开关特性
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-3.1-2 二极管与门
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-3.1-3 二极管或门
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-3.1-4 二极管门电路的缺点
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-3.2-1 MOS管的基本构造和工作原理
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-3.2-2 MOS管的开关特性
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-3.2-3 MOS管的工作特性曲线
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-3.3-1 CMOS反相器的电路结构和工作原理
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-3.3-2 CMOS反相器的电压电流传输特性
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-3.3-3 CMOS反相器的静态输入输出特性
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-3.3-4 CMOS反相器的动态特性
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-3.3-5 CMOS反相器的总功耗
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-第三周--第三周作业
-3.4-1 其他逻辑功能的CMOS门电路
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-3.4-2 带缓冲级的CMOS门电路
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-3.4-3 漏极开路的门电路
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-3.4-4 CMOS传输门和三态门
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-3.5-1-1 双极型三极管的输入输出特性
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-3.5-1-2 双极型三极管的基本开关电路
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-3.5-1-3 双极型三极管的开关等效电路、三极管反相器
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-第四周--第四周作业
-3.5-2-1 TTL反相器的电路结构
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-3.5-2-2 TTL反相器的工作原理
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-3.5-2-3 TTL反相器中的几个 问题和输入噪声容限
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-3.5-3-1 TTL反相器的输入输出特性
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-3.5-3-2 TTL反相器的输入端负载特性
--Video
-3.5-3-3 TTL反相器的扇出系数
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-3.5-4-1 TTL反相器的传输延迟时间
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-3.5-4-2 TTL反相器的交流噪声容限
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-3.5-4-3 电源的动态尖峰电流
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-3.5-5-1 其他逻辑功能的TTL门电路
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-3.5-5-2 集电极开路输出的门电路
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-3.5-5-3 三态输出门
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-实验一：与非门电压传输特性曲线的观测
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-实验二：与非门传输延迟时间的测量
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-第五周--第五周作业
-4.1 组合逻辑电路的特点
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-4.2-1 组合逻辑电路的分析方法
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-4.2-2 组合逻辑电路的设计方法
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-4.3-1-1 若干常用组合逻辑电路：普通编码器
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-4.3-1-2-1 优先编码器
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-4.3-1-2-2 优先编码器的扩展
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-4.3-1-3 二-十进制优先编码器
--Video
-4.3-2-1 译码器
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-4.3-2-2 二进制译码器的扩展
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-4.3-2-3-1 显示译码器
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-4.3-2-3-2 显示译码器附加控制端的作用
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-4.3-2-4 用译码器设计组合逻辑电路
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-4.3-3-1 数据选择器
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-4.3-3-2 用数据选择器设计组合电路
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-4.3-4-1 加法器
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-4.3-4-2 多位加法器
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-4.3-4-3 用加法器设计组合电路
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-4.3-5 数值比较器
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-4.4-1_4.4-2 组合逻辑电路中的竞争-冒险现象
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-4.4-3 消除竞争-冒险现象的方法
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-第六周--第六周作业
-4.5 可编程器件及EDA1
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-5.0 触发器的由来
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-5.1 门电路与触发器的关系
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-5.2 基本RS锁存器
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-5.3-1 电平触发的SR触发器
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-5.3-2 电平触发的D触发器1
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-5.3-3 电平触发的D触发器2
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-5.4-1-1 脉冲触发的触发器--主从D触发器
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-5.4-1-2 脉冲触发的触发器--主从SR触发器
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-5.4-1-3 脉冲触发的触发器--主从JK触发器
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-5.4-2 脉冲触发方式的动作特点
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-5.5 边沿触发的触发器
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-5.6-1 触发器的逻辑功能及其描述方法--SR触发器
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-5.6-2触发器的逻辑功能及其描述方法--JK触发器、T触发器、D触发器
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-第七周--第七周作业
-5.7-1 触发器的动态特性1
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-5.7-2 触发器的动态特性2
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-5.7-3 触发器的动态特性3
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-6.1-1 时序逻辑电路概述
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-6.1-2 时序电路的一般结构形式与功能描述方法
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-6.1.3 时序电路的分类
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-6.2.1-1 同步时序电路的分析方法1
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-6.2.1-2 同步时序电路的分析方法2
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-6.2.3 异步时序电路的分析方法
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-6.3.1-1 寄存器
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-6.3.1-2 移位寄存器1
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-6.3.1-3 移位寄存器2
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-6.3.1-4 移位寄存器扩展应用
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-6.3.2-1-1-1 计数器概述、同步二进制加法计数器
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-6.3.2-1-1-2 同步二进制减法计数器
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-6.3.2-1-1-3 同步加减计数器
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-6.3.2-1-2-1 同步十进制加法计数器
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-6.3.2-1-2-2 同步十进制减法计数器、十进制可逆计数器
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-6.3.2-2 异步计数器
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-第八周--第八周作业
-6.3.2-3-1-1 任意进制计数器的构成方法
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-6.3.2-3-1-2 任意进制计数器的构成方法--举例(N>M)
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-6.3.2-3-1-3 任意进制计数器的构成方法--举例(N<M)
--Video
-6.3.2-4 计数器应用举例
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-6.4.1-1 时序逻辑电路的设计方法
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-6.4.1-2 时序逻辑电路的设计方法--举例
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-6.4.2 时序逻辑电路的动态特性分析
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-7.0 半导体存储器绪论
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-7.1 半导体存储器概述和分类
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-7.2-1 ROM的结构和工作原理
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-7.2-2 可编程ROM1
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-7.2-3 可编程ROM2
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-7.3 RAM的结构和工作原理
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-7.4-1 存储器容量的扩展-位扩展
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-7.4-2 存储器容量的扩展-字扩展
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-7.5 用存储器实现组合逻辑电路
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-第九周--第九周作业
-8.1 可编程逻辑器件概述
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-8.2-8.3-8.4 可编程逻辑器件-FPLA/PAL/GAL
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-8.5-8.6-8.7 可编程逻辑器件-EPLD/CPLD/FPGA
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-8.8-8.9 可编程逻辑器件-ISPGDS、PLD的使用
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-10.1-1 脉冲波形的产生和整形概述
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-10.1-2-10.2.1 门电路组成的施密特触发器
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-10.2.2 集成施密特触发器
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-10.2.3 施密特触发器的主要特点和应用
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-10.3.1-1-1 积分型单稳态触发器--结构和工作原理
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-10.3.1-1-2 积分型单稳态触发器--性能参数计算
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-10.3.1-2-1 微分型单稳态触发器--结构和工作原理
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-10.3.1-2-2 微分型单稳态触发器--性能参数计算
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-10.3.2 集成单稳态触发器
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-10.4.1 用施密特触发器构成的多谐振荡器
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-10.4.2 对称式多谐振荡器
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-10.4.3 非对称式多谐振荡器
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-第十周--第十周作业
-10.4.4 环形振荡器
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-10.4.5 石英晶体多谐振荡器
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-10.5 脉冲电路的分析方法
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-10.6.1 555定时器电路的结构与功能
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-10.6.2 用555定时器接成施密特触发器
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-10.6.3 用556定时器接成单稳态触发器
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-10.6.4 用557定时器接成多谐振荡器
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-11.1 数模和模数转换概述
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-11.2.1 权电阻网络D/A转换器
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-11.2.2 倒T型电阻网络D/A转换器
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-11.2.3 具有双极性输出的电阻网络D/A转换器
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-11.2.4 D/A转换器的转换精度和速度
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-11.3.1 A/D转换的基本原理
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-11.3.2 采样保持电路
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-11.3.3 并联比较型A/D转换器
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-11.3.4-1 反馈比较型A/D转换器--计数型
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-11.3.4-2 反馈比较型A/D转换器--逐次渐进型
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-11.3.5 双积分型和V-F型A/D转换器
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-第十一周--第十一周作业
-I-概述、电路设计及功能仿真
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-II-指定芯片及时序仿真
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-III-选外设（自动化）、锁定引脚并生成下载文件
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-IV-电路扩展设计
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-V-用Verilog描述状态机电路
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