当前课程知识点：数字电子技术基础 > 第七周 > 5.3-2 电平触发的D触发器1 > Video
那下边我们再来看一下
如果我们把前边的
这个电平触发的SR触发器
做一点点小小的改变
刚才我们不是说嘛
说S和R仍然需要满足约束条件
这个约束条件说什么呢
说S和R不能同为1
如果同为1的话就会出现
我们前边讲的这个情况
Q和Q'会在触发信号打开的时候
也就是CLK等于1的时候
Q和Q'都为1
如果Q和Q'都为1的话
当CLK从1变0
那么它就会出现一个
不确定的状况
那我们有一个解除约束条件
最简单的方法
就是做一点点改变
大家看我如果把这个S和R
因为置1，置0信号总是相反的
S等于1的时候R要等于0
R要等于1的时候S要等于0
那么它们两个既然总是相反
我还不如就引入一个信号
用数据信号D来说明
我到底想写入1还是写入0
取反之后把它变成R信号
那就是说S和R之间
加一个反相器
然后把这个标识信号
变成一个D信号
那这就解除了约束条件
因为我的输入就是一个信号
那我给1的时候
它相当于给的过去的SR的1 0
我给0的时候
相当于给的过去的SR信号的01
那我们可以对应到
我们前边看到的这个状态表
那就是说在CLK等于1期间
D信号为1的时候
代表的就是S等于1，R等于0的
这两行
而CLK等于1期间
D信号等于0的时候
代表的就是这两行
那也就是说当我的电路结构
发生改变之后
我的状态表就变成了
现在深蓝色的这一部分
这一部分就代表了我的工作状态
那它已经从电路结构上
就根本的解除了约束条件
那我们说这样的改变很好
好在哪儿呢
好在我不再想
会不会出现SR同为1的时候
这样的约束条件
但是我们也要注意到
当你做电路改变的时候
你得到一个特性的时候
有可能你会丢失别的特性
比方说在这个电路当中
是不是出现了S和R同为0
本来是可以做保持的
那这个电路现在
不具备这个功能了
那它什么时候保持呢
当触发信号没有到来的时候
那也就是说CLK等于0的时候
我是保持
那CLK一旦等于1
就把D的信号写入Q和Q'
那好这是我们从前边的
电平触发的SR锁存器
通过稍稍的改动
变成了一个电平触发的D触发器
那我们再换一个角度
来构成电平触发的D触发器
这是我们前边学习过的
二选一数据选择器
那么二选一数据选择器
大家应该清楚的记得它的功能
它说S等于1的时候
Y等于B
S等于0的时候
Y等于A
这就是一个二选一数据选择器
我们说在数字电路当中
数据选择器是一个广泛使用的
电路模块
这个模块像一个单刀多掷的开关
在二选一数据选择器当中
它就是一个单刀双掷的开关
那我们看
这个电路我如果做这么一点点
小小改变
加一条反馈线
如果在组合电路当中
这样的反馈线
是不允许在设计当中存在的
但是我把这个不是在组合当中
我把它变成这样
我说数据选择器
加入这样的回环之后
我把它重新标识一下
大家看它是不是也完成了
我前边所说的D触发器的功能
它说G等于0的时候
Q保持自己过去的值
G等于1的时候
把新的数据写进来
那我们如果把刚才的所说
用表格把它整理出来的话
就是我们前边说的状态表
你会发现G等于0的时候
Q保持自己
G等于1的时候
Q取D的值
那它最大的不同
就在于在这个表当中
这个Q你会发现
Q又作为输入 又作为输出
这也是我们前面讲的
时序电路跟组合电路当中
一个最大的不同
那我们下边就来看一下
通过这样的电路构造
如果我得到了这么一个触发器
那这个触发器是怎么工作的
它说在G等于1的期间
在G等于1期间
数据D可以写到Q
由于数据D到Q
仍然应该遵从我们组合电路当中
讲到的传出（06：15）
所以你会发现
当有一个新数据出现的时候
要过一段时间
这个数据才会站在
你的触发器的Q端
当一个新数据出现
变成V2的时候
要过一段时间
这个数据才会站在Q端
那么也就是说G等于1的期间
Q是跟随D的
那么D是什么值
Q就是什么值
那么G要是等于0呢
G要是等于0的期间
由于数据选择器
我们知道它的功能
G等于0期间
是把G等于0的这个输入端的
这一部分的数据又回来
而这时候有一个回环
所以我的输出保持不变
大家看到这儿
G等于0的时候
Q由于刚才最后写入的值
是这个值
所以我保持不变
-0.1 数字量和模拟量
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-0.2 电子技术的发展历程
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-0.3 课程的基本任务
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-1.1 信息与编码
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-1.2 二进制的补码
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-1.3 二进制补码运算的符号位
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-1.4 二进制的编码
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-1.5 用电压来表达信息
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-1.6 电压信号的离散化
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-2.1 逻辑代数概述
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-2.2 逻辑代数的三种基本运算
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-第一周--第一周作业
-2.3 几种常用的复合逻辑运算
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-2.4 逻辑代数的基本公式和常用公式
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-2.5 逻辑代数的基本定理
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-2.6 逻辑函数及其表示方法
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-2.7 逻辑函数形式的变换
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-2.8 逻辑函数的化简
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-2.9 逻辑函数的最小项之和
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-2.10 逻辑函数的最大项之积
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-2.11 最小项和最大项的关系
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-2.12 逻辑函数的卡诺图
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-2.13 卡诺图化简法
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-2.14 具有无关项的逻辑函数及其化简
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-2.15 逻辑函数的机器化化简法
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-第二周--第二周作业
-3.0 门电路概述
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-3.1-1 半导体二极管的开关特性
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-3.1-2 二极管与门
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-3.1-3 二极管或门
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-3.1-4 二极管门电路的缺点
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-3.2-1 MOS管的基本构造和工作原理
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-3.2-2 MOS管的开关特性
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-3.2-3 MOS管的工作特性曲线
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-3.3-1 CMOS反相器的电路结构和工作原理
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-3.3-2 CMOS反相器的电压电流传输特性
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-3.3-3 CMOS反相器的静态输入输出特性
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-3.3-4 CMOS反相器的动态特性
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-3.3-5 CMOS反相器的总功耗
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-第三周--第三周作业
-3.4-1 其他逻辑功能的CMOS门电路
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-3.4-2 带缓冲级的CMOS门电路
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-3.4-3 漏极开路的门电路
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-3.4-4 CMOS传输门和三态门
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-3.5-1-1 双极型三极管的输入输出特性
--Video
-3.5-1-2 双极型三极管的基本开关电路
--Video
-3.5-1-3 双极型三极管的开关等效电路、三极管反相器
--Video
-第四周--第四周作业
-3.5-2-1 TTL反相器的电路结构
--Video
-3.5-2-2 TTL反相器的工作原理
--Video
-3.5-2-3 TTL反相器中的几个 问题和输入噪声容限
--Video
-3.5-3-1 TTL反相器的输入输出特性
--Video
-3.5-3-2 TTL反相器的输入端负载特性
--Video
-3.5-3-3 TTL反相器的扇出系数
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-3.5-4-1 TTL反相器的传输延迟时间
--Video
-3.5-4-2 TTL反相器的交流噪声容限
--Video
-3.5-4-3 电源的动态尖峰电流
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-3.5-5-1 其他逻辑功能的TTL门电路
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-3.5-5-2 集电极开路输出的门电路
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-3.5-5-3 三态输出门
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-实验一：与非门电压传输特性曲线的观测
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-实验二：与非门传输延迟时间的测量
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-第五周--第五周作业
-4.1 组合逻辑电路的特点
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-4.2-1 组合逻辑电路的分析方法
--Video
-4.2-2 组合逻辑电路的设计方法
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-4.3-1-1 若干常用组合逻辑电路：普通编码器
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-4.3-1-2-1 优先编码器
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-4.3-1-2-2 优先编码器的扩展
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-4.3-1-3 二-十进制优先编码器
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-4.3-2-1 译码器
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-4.3-2-2 二进制译码器的扩展
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-4.3-2-3-1 显示译码器
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-4.3-2-3-2 显示译码器附加控制端的作用
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-4.3-2-4 用译码器设计组合逻辑电路
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-4.3-3-1 数据选择器
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-4.3-3-2 用数据选择器设计组合电路
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-4.3-4-1 加法器
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-4.3-4-2 多位加法器
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-4.3-4-3 用加法器设计组合电路
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-4.3-5 数值比较器
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-4.4-1_4.4-2 组合逻辑电路中的竞争-冒险现象
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-4.4-3 消除竞争-冒险现象的方法
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-第六周--第六周作业
-4.5 可编程器件及EDA1
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-5.0 触发器的由来
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-5.1 门电路与触发器的关系
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-5.2 基本RS锁存器
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-5.3-1 电平触发的SR触发器
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-5.3-2 电平触发的D触发器1
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-5.3-3 电平触发的D触发器2
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-5.4-1-1 脉冲触发的触发器--主从D触发器
--Video
-5.4-1-2 脉冲触发的触发器--主从SR触发器
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-5.4-1-3 脉冲触发的触发器--主从JK触发器
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-5.4-2 脉冲触发方式的动作特点
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-5.5 边沿触发的触发器
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-5.6-1 触发器的逻辑功能及其描述方法--SR触发器
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-5.6-2触发器的逻辑功能及其描述方法--JK触发器、T触发器、D触发器
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-第七周--第七周作业
-5.7-1 触发器的动态特性1
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-5.7-2 触发器的动态特性2
--Video
-5.7-3 触发器的动态特性3
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-6.1-1 时序逻辑电路概述
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-6.1-2 时序电路的一般结构形式与功能描述方法
--Video
-6.1.3 时序电路的分类
--Video
-6.2.1-1 同步时序电路的分析方法1
--Video
-6.2.1-2 同步时序电路的分析方法2
--Video
-6.2.3 异步时序电路的分析方法
--Video
-6.3.1-1 寄存器
--Video
-6.3.1-2 移位寄存器1
--Video
-6.3.1-3 移位寄存器2
--Video
-6.3.1-4 移位寄存器扩展应用
--Video
-6.3.2-1-1-1 计数器概述、同步二进制加法计数器
--Video
-6.3.2-1-1-2 同步二进制减法计数器
--Video
-6.3.2-1-1-3 同步加减计数器
--Video
-6.3.2-1-2-1 同步十进制加法计数器
--Video
-6.3.2-1-2-2 同步十进制减法计数器、十进制可逆计数器
--Video
-6.3.2-2 异步计数器
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-第八周--第八周作业
-6.3.2-3-1-1 任意进制计数器的构成方法
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-6.3.2-3-1-2 任意进制计数器的构成方法--举例(N>M)
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-6.3.2-3-1-3 任意进制计数器的构成方法--举例(N<M)
--Video
-6.3.2-4 计数器应用举例
--Video
-6.4.1-1 时序逻辑电路的设计方法
--Video
-6.4.1-2 时序逻辑电路的设计方法--举例
--Video
-6.4.2 时序逻辑电路的动态特性分析
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-7.0 半导体存储器绪论
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-7.1 半导体存储器概述和分类
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-7.2-1 ROM的结构和工作原理
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-7.2-2 可编程ROM1
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-7.2-3 可编程ROM2
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-7.3 RAM的结构和工作原理
--Video
-7.4-1 存储器容量的扩展-位扩展
--Video
-7.4-2 存储器容量的扩展-字扩展
--Video
-7.5 用存储器实现组合逻辑电路
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-第九周--第九周作业
-8.1 可编程逻辑器件概述
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-8.2-8.3-8.4 可编程逻辑器件-FPLA/PAL/GAL
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-8.5-8.6-8.7 可编程逻辑器件-EPLD/CPLD/FPGA
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-8.8-8.9 可编程逻辑器件-ISPGDS、PLD的使用
--Video
-10.1-1 脉冲波形的产生和整形概述
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-10.1-2-10.2.1 门电路组成的施密特触发器
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-10.2.2 集成施密特触发器
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-10.2.3 施密特触发器的主要特点和应用
--Video
-10.3.1-1-1 积分型单稳态触发器--结构和工作原理
--Video
-10.3.1-1-2 积分型单稳态触发器--性能参数计算
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-10.3.1-2-1 微分型单稳态触发器--结构和工作原理
--Video
-10.3.1-2-2 微分型单稳态触发器--性能参数计算
--Video
-10.3.2 集成单稳态触发器
--Video
-10.4.1 用施密特触发器构成的多谐振荡器
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-10.4.2 对称式多谐振荡器
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-10.4.3 非对称式多谐振荡器
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-第十周--第十周作业
-10.4.4 环形振荡器
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-10.4.5 石英晶体多谐振荡器
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-10.5 脉冲电路的分析方法
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-10.6.1 555定时器电路的结构与功能
--Video
-10.6.2 用555定时器接成施密特触发器
--Video
-10.6.3 用556定时器接成单稳态触发器
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-10.6.4 用557定时器接成多谐振荡器
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-11.1 数模和模数转换概述
--Video
-11.2.1 权电阻网络D/A转换器
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-11.2.2 倒T型电阻网络D/A转换器
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-11.2.3 具有双极性输出的电阻网络D/A转换器
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-11.2.4 D/A转换器的转换精度和速度
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-11.3.1 A/D转换的基本原理
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-11.3.2 采样保持电路
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-11.3.3 并联比较型A/D转换器
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-11.3.4-1 反馈比较型A/D转换器--计数型
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-11.3.4-2 反馈比较型A/D转换器--逐次渐进型
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-11.3.5 双积分型和V-F型A/D转换器
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-第十一周--第十一周作业
-I-概述、电路设计及功能仿真
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-II-指定芯片及时序仿真
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-III-选外设（自动化）、锁定引脚并生成下载文件
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-IV-电路扩展设计
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-V-用Verilog描述状态机电路
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