当前课程知识点：数字电子技术基础 > 第九周 > 7.2-2 可编程ROM1 > Video
可编程ROM通称PROM
这是关于Programmable ROM的
一个缩写
它的意思是这类器件
在出厂的时候数据没有确定
那谁来确定这个数据呢
由使用者根据自己的需要
来确定这个数据
也就是说它提供了一种可能
生产厂家在生产的时候
确定的只是存储容量
也就是只确定了我的规模
那么在这个规模下
你要存的是什么数据
究竟是什么
由这个使用者来确定
那这是我们在做实验
和做我们平常的开发设计当中
急切需要的一类器件
这类器件大家记住
它有一个核心的问题是
总体结构与我们前面讲的
掩模ROM完全一样
那刚才我们已经了解了
掩模ROM分为三块
一块是地址译码器 存储矩阵
还有一个输出缓冲
地址译码 输出缓冲是共用的
而存储矩阵
就是我们现在要存数据的地方
是根据我们可编程做了改变
那么最早的PROM
它的存储单元结构如图所示
大家看到这个图已经省略了
我们前边的字线的来源
就是地址译码那部分省略了
把后边部分缓冲也去掉了
我们关注这个存储单元
也就是每一个字线
和位线的交叉点
每一个字线和位线的交叉点
前边我们已经掌握了
说字线和位线它的连接
是否有这个器件的连接
来确定我到底存0还是存1
那么大家看这个结构
在PROM 最早的PROM
采用了熔丝结构
我们熔丝这个概念
在我们平常生活当中
接触的最多的就是保险丝
那保险丝有连通的时候
也可以有熔断的时候
它就引用了这样的概念
在这个结构当中
上边接着一个三极管
一个熔丝字线和位线相连
那么如果你想要它正常相连的话
出厂的时候都是相连的
那如果在你使用过程当中
你希望这个字线和位线
不连接的话
那可以采用控制
三极管的电流放大的效应
让熔丝过电流熔断
那么熔丝一旦熔断之后
我们知道不可恢复
也就是我出厂的时候
本来相连的关系
可以根据我的需要让它断开
有了这样的相连和断开的区别
也就可以区别所存储的0和1
整个的PROM它的结构
就是像我们刚才所说
那么大家看到
前边的地址译码器部分
与前边相同
与我们前边讲的ROM相同
译出所有的最小项
字线和位线的交叉点处
每一个存储单元
都有这样的一个熔丝结构
那我们现在可以稍微复习一下
在这个图当中
在这样的结构下
大家可以看一下
它的容量是多少
这个容量你应该关注的
不是它如何实现
而是它的接口
地址译码器有四个地址输入变量
而最后的数据有八位输出
因此就图中的这个结构来看
它的存储容量是2的4次方乘以8
那如果有了这样的结构
我们说它基本具备了
可编程的可能性
那么熔丝是由易熔合金制成
出厂的时候
每一个点上都有
编程的时候将不用的熔断
那这是最早的可编程
最早的可编程ROM
也同时在使用过程当中
大家又发现了它的不足
那它的不足就是什么呢
就是说我如果一次编程完毕之后
就像刚才说的
熔丝被熔断之后
断开就没有办法再修复
那也就是说我的可编程
是一次性的
是不能改写的
而且我们也知道
这个器件刚才说了
我如果是正常使用的时候
我并不需要大电流
但是在编程的时候
要熔断谁的时候
我需要有精准的控制
每一位需要熔断的那个三极管
处在电流放大 把熔丝熔断
所以这个写入的时候
一定要外边要用编程器
那么为了配合我们前边说的
在编程的时候
需要有写入的这个功能
大家可以看看
它最后的这个输出结构
不再像前边的掩模ROM
只是单纯的输出
在这个结构当中
它有了读写放大器
那也就是对于我们来讲
它在编程结构的时候
是从数据端往里写
当我编程完毕之后
正常使用的时候
从编程器上边下来
在正常系统当中使用的时候
我是一个读的状态
这就是我们说的PROM
-0.1 数字量和模拟量
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-0.2 电子技术的发展历程
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-0.3 课程的基本任务
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-1.1 信息与编码
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-1.2 二进制的补码
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-1.3 二进制补码运算的符号位
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-1.4 二进制的编码
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-1.5 用电压来表达信息
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-1.6 电压信号的离散化
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-2.1 逻辑代数概述
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-2.2 逻辑代数的三种基本运算
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-第一周--第一周作业
-2.3 几种常用的复合逻辑运算
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-2.4 逻辑代数的基本公式和常用公式
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-2.5 逻辑代数的基本定理
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-2.6 逻辑函数及其表示方法
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-2.7 逻辑函数形式的变换
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-2.8 逻辑函数的化简
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-2.9 逻辑函数的最小项之和
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-2.10 逻辑函数的最大项之积
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-2.11 最小项和最大项的关系
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-2.12 逻辑函数的卡诺图
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-2.13 卡诺图化简法
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-2.14 具有无关项的逻辑函数及其化简
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-2.15 逻辑函数的机器化化简法
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-第二周--第二周作业
-3.0 门电路概述
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-3.1-1 半导体二极管的开关特性
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-3.1-2 二极管与门
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-3.1-3 二极管或门
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-3.1-4 二极管门电路的缺点
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-3.2-1 MOS管的基本构造和工作原理
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-3.2-2 MOS管的开关特性
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-3.2-3 MOS管的工作特性曲线
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-3.3-1 CMOS反相器的电路结构和工作原理
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-3.3-2 CMOS反相器的电压电流传输特性
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-3.3-3 CMOS反相器的静态输入输出特性
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-3.3-4 CMOS反相器的动态特性
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-3.3-5 CMOS反相器的总功耗
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-第三周--第三周作业
-3.4-1 其他逻辑功能的CMOS门电路
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-3.4-2 带缓冲级的CMOS门电路
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-3.4-3 漏极开路的门电路
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-3.4-4 CMOS传输门和三态门
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-3.5-1-1 双极型三极管的输入输出特性
--Video
-3.5-1-2 双极型三极管的基本开关电路
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-3.5-1-3 双极型三极管的开关等效电路、三极管反相器
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-第四周--第四周作业
-3.5-2-1 TTL反相器的电路结构
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-3.5-2-2 TTL反相器的工作原理
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-3.5-2-3 TTL反相器中的几个 问题和输入噪声容限
--Video
-3.5-3-1 TTL反相器的输入输出特性
--Video
-3.5-3-2 TTL反相器的输入端负载特性
--Video
-3.5-3-3 TTL反相器的扇出系数
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-3.5-4-1 TTL反相器的传输延迟时间
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-3.5-4-2 TTL反相器的交流噪声容限
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-3.5-4-3 电源的动态尖峰电流
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-3.5-5-1 其他逻辑功能的TTL门电路
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-3.5-5-2 集电极开路输出的门电路
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-3.5-5-3 三态输出门
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-实验一：与非门电压传输特性曲线的观测
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-实验二：与非门传输延迟时间的测量
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-第五周--第五周作业
-4.1 组合逻辑电路的特点
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-4.2-1 组合逻辑电路的分析方法
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-4.2-2 组合逻辑电路的设计方法
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-4.3-1-1 若干常用组合逻辑电路：普通编码器
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-4.3-1-2-1 优先编码器
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-4.3-1-2-2 优先编码器的扩展
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-4.3-1-3 二-十进制优先编码器
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-4.3-2-1 译码器
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-4.3-2-2 二进制译码器的扩展
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-4.3-2-3-1 显示译码器
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-4.3-2-3-2 显示译码器附加控制端的作用
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-4.3-2-4 用译码器设计组合逻辑电路
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-4.3-3-1 数据选择器
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-4.3-3-2 用数据选择器设计组合电路
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-4.3-4-1 加法器
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-4.3-4-2 多位加法器
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-4.3-4-3 用加法器设计组合电路
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-4.3-5 数值比较器
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-4.4-1_4.4-2 组合逻辑电路中的竞争-冒险现象
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-4.4-3 消除竞争-冒险现象的方法
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-第六周--第六周作业
-4.5 可编程器件及EDA1
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-5.0 触发器的由来
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-5.1 门电路与触发器的关系
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-5.2 基本RS锁存器
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-5.3-1 电平触发的SR触发器
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-5.3-2 电平触发的D触发器1
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-5.3-3 电平触发的D触发器2
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-5.4-1-1 脉冲触发的触发器--主从D触发器
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-5.4-1-2 脉冲触发的触发器--主从SR触发器
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-5.4-1-3 脉冲触发的触发器--主从JK触发器
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-5.4-2 脉冲触发方式的动作特点
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-5.5 边沿触发的触发器
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-5.6-1 触发器的逻辑功能及其描述方法--SR触发器
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-5.6-2触发器的逻辑功能及其描述方法--JK触发器、T触发器、D触发器
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-第七周--第七周作业
-5.7-1 触发器的动态特性1
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-5.7-2 触发器的动态特性2
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-5.7-3 触发器的动态特性3
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-6.1-1 时序逻辑电路概述
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-6.1-2 时序电路的一般结构形式与功能描述方法
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-6.1.3 时序电路的分类
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-6.2.1-1 同步时序电路的分析方法1
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-6.2.1-2 同步时序电路的分析方法2
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-6.2.3 异步时序电路的分析方法
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-6.3.1-1 寄存器
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-6.3.1-2 移位寄存器1
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-6.3.1-3 移位寄存器2
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-6.3.1-4 移位寄存器扩展应用
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-6.3.2-1-1-1 计数器概述、同步二进制加法计数器
--Video
-6.3.2-1-1-2 同步二进制减法计数器
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-6.3.2-1-1-3 同步加减计数器
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-6.3.2-1-2-1 同步十进制加法计数器
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-6.3.2-1-2-2 同步十进制减法计数器、十进制可逆计数器
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-6.3.2-2 异步计数器
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-第八周--第八周作业
-6.3.2-3-1-1 任意进制计数器的构成方法
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-6.3.2-3-1-2 任意进制计数器的构成方法--举例(N>M)
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-6.3.2-3-1-3 任意进制计数器的构成方法--举例(N<M)
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-6.3.2-4 计数器应用举例
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-6.4.1-1 时序逻辑电路的设计方法
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-6.4.1-2 时序逻辑电路的设计方法--举例
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-6.4.2 时序逻辑电路的动态特性分析
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-7.0 半导体存储器绪论
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-7.1 半导体存储器概述和分类
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-7.2-1 ROM的结构和工作原理
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-7.2-2 可编程ROM1
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-7.2-3 可编程ROM2
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-7.3 RAM的结构和工作原理
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-7.4-1 存储器容量的扩展-位扩展
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-7.4-2 存储器容量的扩展-字扩展
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-7.5 用存储器实现组合逻辑电路
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-第九周--第九周作业
-8.1 可编程逻辑器件概述
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-8.2-8.3-8.4 可编程逻辑器件-FPLA/PAL/GAL
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-8.5-8.6-8.7 可编程逻辑器件-EPLD/CPLD/FPGA
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-8.8-8.9 可编程逻辑器件-ISPGDS、PLD的使用
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-10.1-1 脉冲波形的产生和整形概述
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-10.1-2-10.2.1 门电路组成的施密特触发器
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-10.2.2 集成施密特触发器
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-10.2.3 施密特触发器的主要特点和应用
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-10.3.1-1-1 积分型单稳态触发器--结构和工作原理
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-10.3.1-1-2 积分型单稳态触发器--性能参数计算
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-10.3.1-2-1 微分型单稳态触发器--结构和工作原理
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-10.3.1-2-2 微分型单稳态触发器--性能参数计算
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-10.3.2 集成单稳态触发器
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-10.4.1 用施密特触发器构成的多谐振荡器
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-10.4.2 对称式多谐振荡器
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-10.4.3 非对称式多谐振荡器
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-第十周--第十周作业
-10.4.4 环形振荡器
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-10.4.5 石英晶体多谐振荡器
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-10.5 脉冲电路的分析方法
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-10.6.1 555定时器电路的结构与功能
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-10.6.2 用555定时器接成施密特触发器
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-10.6.3 用556定时器接成单稳态触发器
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-10.6.4 用557定时器接成多谐振荡器
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-11.1 数模和模数转换概述
--Video
-11.2.1 权电阻网络D/A转换器
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-11.2.2 倒T型电阻网络D/A转换器
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-11.2.3 具有双极性输出的电阻网络D/A转换器
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-11.2.4 D/A转换器的转换精度和速度
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-11.3.1 A/D转换的基本原理
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-11.3.2 采样保持电路
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-11.3.3 并联比较型A/D转换器
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-11.3.4-1 反馈比较型A/D转换器--计数型
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-11.3.4-2 反馈比较型A/D转换器--逐次渐进型
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-11.3.5 双积分型和V-F型A/D转换器
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-第十一周--第十一周作业
-I-概述、电路设计及功能仿真
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-II-指定芯片及时序仿真
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-III-选外设（自动化）、锁定引脚并生成下载文件
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-IV-电路扩展设计
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-V-用Verilog描述状态机电路
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