当前课程知识点：数字电子技术基础 > 第五周 > 3.5-3-2 TTL反相器的输入端负载特性 > Video
TTL的静态特性
除了输入输出特性之外
还有一个特性是它比较特殊的
我们称之为输入端负载特性
我们说一般来说
提到负载都会认为是输出
那么TTL反相器
和TTL类型的器件
它在输入端有负载特性
我们下边就来看一下
如果说我在TTL反向器的输入端
通过一个可变电阻接地
我问输出会看到什么
那这个时候
如果这个电阻的取值是0
我们说相当于输入一个低电平
那输出就是高电平
那现在如果慢慢地
把这个RP这个电阻的电阻值调大
输出会有变化吗
我们先看一下
如果是0的时候
如果是0的时候
输入相当于是一个低电平
那这个时候流过输入的电流值
是多少呢
就应该是VCC减去0.7除以R1
那随着这个RP的增大
我们调节这个RP
随着这个RP的增大
我们会发现这个时候
VI会因为RP的增大
会抬高这个电压
如果我们现在来用万用表
看一下这点的电压的时候
你会发现随着RP的增大
VI 电压值会上升
那为什么会出现这种情况呢
我们把这个电路
仔细的分析一下它的输入
是不是VI就等于VCC减去VBE1
也就是0.7
然后R1和RP之间的分压
那么得到这个式子之后
你会发现
随着RP的上升
你的VI是会上升的
RP上升 如果VI上升
VI要是上升了
是不是就势必推动电路内部
T1 T2 （T5）T4管的工作状态发生变化
那在RP很小的时候
相当于VI等于0
那这个时候输出是高电平
但是随着RP的上升
上升到多少呢
上升到当VBE1等于2.1V的时候
这个时候虽然我输入的前端
没有加入高电平
但是由于VB1现在到了2.1V
那就是T2 T5管现在导通了
那我的输出就会给出低电平
而且由于VB1上升到2.1V
前端的RP即便再上升
VI也不会上升
那么VI会是多少呢
我们说它会从0一直上升到多少
上升到1.4V
上升到1.4V
VI不再上升
那也就是说
对于我们来讲
在VI上升到1.4V之前
我输入电阻的变化
对应到输出
看上去是一个低电平
而在我上升到1.4V之后
虽然我的输入端没有接高电平
但是我从输出端看上去
好像是一个高电平
那对于74系列来讲
由于R1是4个千欧
也就是4千欧
那么跟它分压的RP
这时候就能够明确的算出来
在RP是0.9K的时候
输入的电平
分压电平VI会达到了0.8V
这个时候就已经到了
输入低电平的临界值了
那随着RP继续上升
如果你上升到2千欧的时候
这个时候你的分压会
把VB1抬高到了2.1V
而VI抬高到了1.4V
这个时候从输出端看过去
它就相当于输出一个低电平了
那输入端悬空和接高电平
就看上去是等效的了
注意 我说是看上去
而且是从输出端看上去
那我们对刚才
我们所分析的这个特性
和这个表达式
用图形来表达出来的话
我们可以得到这么一个曲线
说随着RP的上升 VI会上升
但是上升到多少呢
上升到1.4V之后不再上升了
那么当它一旦上升到1.4V之后
这个电路从输出端看过来
就相当于输入接了一个高电平
好 那么基于刚才的讲述
我们下边就来判断一下
这个电路能不能正常工作
下边这个电路
由两个反相器 级联
而中间接了一个电阻
我们说这一定不是我们
想这么接的
现在仅仅是为了来了解一下
输入负载特性曲线
我们看一下
如果接有这个电阻的话
这个电阻如果小 没有问题
就是一根导线
那么两个反相器用导线连起来
那么它们肯定可以工作
如果两个反相器
中间接一个电阻
如果这个电阻太大
会有什么问题
按我们刚才的分析
如果两个反相器
这样 级联 起来
你想正常工作的话
其实就意味着
你的输入信号
能够通过两级反相器
传递出去
但是如果中间这级电阻
太大的话
会出现什么状况呢
我们看 是不是就出现说
前级的一个反相器
输出低电平的时候
由于RP太大
而使得后极反相器的输入
并不能取得这个低电平
而始终是在一个高电平
所以你第一级的信号
没有办法传递
所以没法正常工作
那么我们就能够说
要判断出来
这个电阻不能太大
而且应该根据输入负载特性
有一个判断
他不能大过多少
-0.1 数字量和模拟量
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-0.2 电子技术的发展历程
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-0.3 课程的基本任务
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-1.1 信息与编码
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-1.2 二进制的补码
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-1.3 二进制补码运算的符号位
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-1.4 二进制的编码
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-1.5 用电压来表达信息
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-1.6 电压信号的离散化
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-2.1 逻辑代数概述
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-2.2 逻辑代数的三种基本运算
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-第一周--第一周作业
-2.3 几种常用的复合逻辑运算
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-2.4 逻辑代数的基本公式和常用公式
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-2.5 逻辑代数的基本定理
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-2.6 逻辑函数及其表示方法
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-2.7 逻辑函数形式的变换
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-2.8 逻辑函数的化简
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-2.9 逻辑函数的最小项之和
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-2.10 逻辑函数的最大项之积
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-2.11 最小项和最大项的关系
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-2.12 逻辑函数的卡诺图
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-2.13 卡诺图化简法
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-2.14 具有无关项的逻辑函数及其化简
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-2.15 逻辑函数的机器化化简法
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-第二周--第二周作业
-3.0 门电路概述
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-3.1-1 半导体二极管的开关特性
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-3.1-2 二极管与门
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-3.1-3 二极管或门
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-3.1-4 二极管门电路的缺点
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-3.2-1 MOS管的基本构造和工作原理
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-3.2-2 MOS管的开关特性
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-3.2-3 MOS管的工作特性曲线
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-3.3-1 CMOS反相器的电路结构和工作原理
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-3.3-2 CMOS反相器的电压电流传输特性
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-3.3-3 CMOS反相器的静态输入输出特性
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-3.3-4 CMOS反相器的动态特性
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-3.3-5 CMOS反相器的总功耗
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-第三周--第三周作业
-3.4-1 其他逻辑功能的CMOS门电路
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-3.4-2 带缓冲级的CMOS门电路
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-3.4-3 漏极开路的门电路
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-3.4-4 CMOS传输门和三态门
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-3.5-1-1 双极型三极管的输入输出特性
--Video
-3.5-1-2 双极型三极管的基本开关电路
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-3.5-1-3 双极型三极管的开关等效电路、三极管反相器
--Video
-第四周--第四周作业
-3.5-2-1 TTL反相器的电路结构
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-3.5-2-2 TTL反相器的工作原理
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-3.5-2-3 TTL反相器中的几个 问题和输入噪声容限
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-3.5-3-1 TTL反相器的输入输出特性
--Video
-3.5-3-2 TTL反相器的输入端负载特性
--Video
-3.5-3-3 TTL反相器的扇出系数
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-3.5-4-1 TTL反相器的传输延迟时间
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-3.5-4-2 TTL反相器的交流噪声容限
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-3.5-4-3 电源的动态尖峰电流
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-3.5-5-1 其他逻辑功能的TTL门电路
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-3.5-5-2 集电极开路输出的门电路
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-3.5-5-3 三态输出门
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-实验一：与非门电压传输特性曲线的观测
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-实验二：与非门传输延迟时间的测量
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-第五周--第五周作业
-4.1 组合逻辑电路的特点
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-4.2-1 组合逻辑电路的分析方法
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-4.2-2 组合逻辑电路的设计方法
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-4.3-1-1 若干常用组合逻辑电路：普通编码器
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-4.3-1-2-1 优先编码器
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-4.3-1-2-2 优先编码器的扩展
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-4.3-1-3 二-十进制优先编码器
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-4.3-2-1 译码器
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-4.3-2-2 二进制译码器的扩展
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-4.3-2-3-1 显示译码器
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-4.3-2-3-2 显示译码器附加控制端的作用
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-4.3-2-4 用译码器设计组合逻辑电路
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-4.3-3-1 数据选择器
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-4.3-3-2 用数据选择器设计组合电路
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-4.3-4-1 加法器
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-4.3-4-2 多位加法器
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-4.3-4-3 用加法器设计组合电路
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-4.3-5 数值比较器
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-4.4-1_4.4-2 组合逻辑电路中的竞争-冒险现象
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-4.4-3 消除竞争-冒险现象的方法
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-第六周--第六周作业
-4.5 可编程器件及EDA1
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-5.0 触发器的由来
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-5.1 门电路与触发器的关系
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-5.2 基本RS锁存器
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-5.3-1 电平触发的SR触发器
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-5.3-2 电平触发的D触发器1
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-5.3-3 电平触发的D触发器2
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-5.4-1-1 脉冲触发的触发器--主从D触发器
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-5.4-1-2 脉冲触发的触发器--主从SR触发器
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-5.4-1-3 脉冲触发的触发器--主从JK触发器
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-5.4-2 脉冲触发方式的动作特点
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-5.5 边沿触发的触发器
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-5.6-1 触发器的逻辑功能及其描述方法--SR触发器
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-5.6-2触发器的逻辑功能及其描述方法--JK触发器、T触发器、D触发器
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-第七周--第七周作业
-5.7-1 触发器的动态特性1
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-5.7-2 触发器的动态特性2
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-5.7-3 触发器的动态特性3
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-6.1-1 时序逻辑电路概述
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-6.1-2 时序电路的一般结构形式与功能描述方法
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-6.1.3 时序电路的分类
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-6.2.1-1 同步时序电路的分析方法1
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-6.2.1-2 同步时序电路的分析方法2
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-6.2.3 异步时序电路的分析方法
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-6.3.1-1 寄存器
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-6.3.1-2 移位寄存器1
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-6.3.1-3 移位寄存器2
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-6.3.1-4 移位寄存器扩展应用
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-6.3.2-1-1-1 计数器概述、同步二进制加法计数器
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-6.3.2-1-1-2 同步二进制减法计数器
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-6.3.2-1-1-3 同步加减计数器
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-6.3.2-1-2-1 同步十进制加法计数器
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-6.3.2-1-2-2 同步十进制减法计数器、十进制可逆计数器
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-6.3.2-2 异步计数器
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-第八周--第八周作业
-6.3.2-3-1-1 任意进制计数器的构成方法
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-6.3.2-3-1-2 任意进制计数器的构成方法--举例(N>M)
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-6.3.2-3-1-3 任意进制计数器的构成方法--举例(N<M)
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-6.3.2-4 计数器应用举例
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-6.4.1-1 时序逻辑电路的设计方法
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-6.4.1-2 时序逻辑电路的设计方法--举例
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-6.4.2 时序逻辑电路的动态特性分析
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-7.0 半导体存储器绪论
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-7.1 半导体存储器概述和分类
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-7.2-1 ROM的结构和工作原理
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-7.2-2 可编程ROM1
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-7.2-3 可编程ROM2
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-7.3 RAM的结构和工作原理
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-7.4-1 存储器容量的扩展-位扩展
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-7.4-2 存储器容量的扩展-字扩展
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-7.5 用存储器实现组合逻辑电路
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-第九周--第九周作业
-8.1 可编程逻辑器件概述
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-8.2-8.3-8.4 可编程逻辑器件-FPLA/PAL/GAL
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-8.5-8.6-8.7 可编程逻辑器件-EPLD/CPLD/FPGA
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-8.8-8.9 可编程逻辑器件-ISPGDS、PLD的使用
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-10.1-1 脉冲波形的产生和整形概述
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-10.1-2-10.2.1 门电路组成的施密特触发器
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-10.2.2 集成施密特触发器
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-10.2.3 施密特触发器的主要特点和应用
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-10.3.1-1-1 积分型单稳态触发器--结构和工作原理
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-10.3.1-1-2 积分型单稳态触发器--性能参数计算
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-10.3.1-2-1 微分型单稳态触发器--结构和工作原理
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-10.3.1-2-2 微分型单稳态触发器--性能参数计算
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-10.3.2 集成单稳态触发器
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-10.4.1 用施密特触发器构成的多谐振荡器
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-10.4.2 对称式多谐振荡器
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-10.4.3 非对称式多谐振荡器
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-第十周--第十周作业
-10.4.4 环形振荡器
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-10.4.5 石英晶体多谐振荡器
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-10.5 脉冲电路的分析方法
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-10.6.1 555定时器电路的结构与功能
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-10.6.2 用555定时器接成施密特触发器
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-10.6.3 用556定时器接成单稳态触发器
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-10.6.4 用557定时器接成多谐振荡器
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-11.1 数模和模数转换概述
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-11.2.1 权电阻网络D/A转换器
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-11.2.2 倒T型电阻网络D/A转换器
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-11.2.3 具有双极性输出的电阻网络D/A转换器
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-11.2.4 D/A转换器的转换精度和速度
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-11.3.1 A/D转换的基本原理
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-11.3.2 采样保持电路
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-11.3.3 并联比较型A/D转换器
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-11.3.4-1 反馈比较型A/D转换器--计数型
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-11.3.4-2 反馈比较型A/D转换器--逐次渐进型
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-11.3.5 双积分型和V-F型A/D转换器
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-第十一周--第十一周作业
-I-概述、电路设计及功能仿真
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-II-指定芯片及时序仿真
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-III-选外设（自动化）、锁定引脚并生成下载文件
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-IV-电路扩展设计
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-V-用Verilog描述状态机电路
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