当前课程知识点：数字电子技术基础 > 第七周 > 5.6-2触发器的逻辑功能及其描述方法--JK触发器、T触发器、D触发器 > Video
我们再来看一下
我们前面学过的JK触发器
JK触发器我们讲的时候
讲的是它通过大回环
是从主从结构来的
主从结构的脉冲的SR触发器
引入两个大反馈
构成了主从结构脉冲触发的
JK触发器
那么它能够实现什么呢
能够实现SR触发器的
所有的功能
还能解除约束
它说在JK等于0的时候是保持
J等于1 K等于0的时候是置1
J等于0 K等于1的时候是置0
J K都为1的时候呢
是对过去的状态取反
那如果我们不关心它如何实现
我们仅仅关心
这样的一个
刚才所描述的功能的话
我们也可以
把这个功能
用我们的方程表达出来
那我们把这个方程写出来
我们取出Q*为1的这几项
有这四项
大家把这四项对应的最小项
写出来之后
稍加整理化简
就可以得到JK触发器的
特性方程是Q*
等于J Q'
再加上K'Q
这就是特性方程
那么有了这个特性方程
我们想把它表达成状态转换图
也很容易
我们说对于一个JK触发器来讲
它仍然是关于1位0 1的存储
也就是电路的状态
非零即一
那么在0 1之间的转换条件呢
它是这样来描述的
它说如果我的现态是0
那么当J等于1的时候
无论K等于什么
它都会把下一个状态
也就是次态置为1
那么当现态是1的时候
那么当我的K等于1
无论J的取值是什么
它都会把我的次态置为0
如果我的现态是0
那么我的次态什么时候还是0呢
你看一下
是说J等于0的时候
只要置1的这个信号没有
J等于0的时候
无论K等于1还是K等于0
我的次态都是0
那么这样
我们就可以把我的这个
特性方程当中
所描述的所有的转换关系
用状态转换图表达出来
那同样我们看到这样的表达
仍然隐含了一个条件
它的条件就是
所有的这些都是在触发
时钟信号触发的情况下
已经触发了
才会发生这样的情况
那我们看一下JK触发器
其实不仅仅有主从结构
还有边沿结构
那么如果我这个电路符号
这样画出来之后
我们说这个表达才完整
以图
以下边这个图的第一个图为例
大家看到这个表达的
是一个边沿触发的JK触发器
而且它是一个上升沿的
触发 JK触发器
这个触发器是在
每次上升沿到达的时候
读取J K的值
决定Q和Q'
不仅它是一个上升沿的
JK触发器
而且这个触发器
还具备异步的置一和清零端
S和R
那么在旁边这个符号当中
这是我们前面讲过的一个
主从结构的脉冲触发的
JK触发器
这个触发器
如果从图中读到的话
它应该是一个下降沿触发
也就是下降沿到达的时候
Q和Q'会发生转换
但是发生转换的依据
应该是在CLK等于1期间
主触发器根据JK组合
所发生的变化
那也就是说主从结构的
脉冲触发器
不能单一的根据特性表
就直接来在边沿刻根据JK
来决定Q和Q'
那么它就保留了
我们前面讲的
主从结构的JK触发器
在主触发器打开期间
只能翻转一次的特性
那下边呢
我们再来看一种
前边我们没有讲过的
一个触发器
我们说T触发器
T触发器说什么呢
T触发器说它是这样定义的
凡是在时钟信号作用下
能够满足如下条件的触发器
我们把它称为T触发器
如下条件它是这么表达的
它说如果T等于0
如果这个触发器的
数据信号T等于0
那么即便是触发信号到达
我的次态也保持现态
如果T等于1
那么我的次态始终
对我的现态取反
也就是
简单的说也就是
T等于0的时候保持
T等于1的时候始终翻转
那我们对这样的一个特性
如果用方程予以表达
那它可以表达成Q*
等于T Q'
再加上T'Q
那这个触发器
我们前边没有讲过它的实现
那我仍然可以根据
这个特性方程
画出它的状态转换图
如果画出状态转换图
大家看一下是不是这样
它说我的这个触发器
有两个状态
T等于0 T等于1
我要么就是保持在
自己的状态始终维持下
维持的条件是什么呢
是T等于0
要么就始终在两个状态之间
跳变
跳变的条件是什么呢
是T等于1
但是无论是维持还是跳变
它都有一个条件
就是时钟信号
也就是说是在触发信号的作用下
来完成这样的一个功能
那我们并不知道
它是怎么实现的
因为前面没有讲过
那大家想一下它怎么实现
可以想一想
大家可以试着想想
它是怎么实现
这个电路可以用JK触发器
把J和K连在一起
就能够构成T触发器
如果构成T触发器之后
我们来看一下
这个电路
这个给出来的电路符号
大家看到
它标识了我的触发信号
这地方有一个三角
代表着这是一个
边沿触发的触发器
而在三角的前面有一个圈
就意味着这是一个
下降沿触发的T触发器
那么S1和1T表达了
它们之间的
控制和耦合的关系
也就是说我们的特性方程
在什么时候会起作用呢
是每一个下降沿到达的时候
它都会来判断T的值是什么
而决定我的Q到底是保持
还是翻转
那除了这个
前边我们讲的RS JK
还有我们没有讲过的T
还有一种触发器
我们前边讲的比较多的
是D触发器
D触发器我们是从
电平触发器开始
一直到主从结构
一直到边沿
那么D触发器的特性
相对比较容易
它是说在时钟信号的作用下
也就是触发的时候
我们都知道是
Q*等于D
也就是在触发的情况下
我的Q始终是跟随D的
那么没有触发的情况下
我的Q就保持
那我们看一下
如果我们要把D触发器的特性
把它描述出来的话
是不是就是这样
Q*等于D
那它的状态转换图呢
那如果说
当触发的这个事情
已经发生的情况下
你现态是零
你的次态怎么样
才能保证是0呢
你只有让你的D等于0
才能保持这个0
在现态是1的情况下
也是这样的分析
那么从符号上来讲
D触发器有多种实现方式
刚才我们说了
比方说边沿的
比方说大家还可以
在往这儿补
有主从 脉冲的
还会有电平的等等
那这就是关于触发器的
逻辑功能的描述
-0.1 数字量和模拟量
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-0.2 电子技术的发展历程
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-0.3 课程的基本任务
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-1.1 信息与编码
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-1.2 二进制的补码
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-1.3 二进制补码运算的符号位
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-1.4 二进制的编码
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-1.5 用电压来表达信息
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-1.6 电压信号的离散化
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-2.1 逻辑代数概述
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-2.2 逻辑代数的三种基本运算
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-第一周--第一周作业
-2.3 几种常用的复合逻辑运算
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-2.4 逻辑代数的基本公式和常用公式
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-2.5 逻辑代数的基本定理
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-2.6 逻辑函数及其表示方法
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-2.7 逻辑函数形式的变换
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-2.8 逻辑函数的化简
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-2.9 逻辑函数的最小项之和
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-2.10 逻辑函数的最大项之积
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-2.11 最小项和最大项的关系
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-2.12 逻辑函数的卡诺图
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-2.13 卡诺图化简法
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-2.14 具有无关项的逻辑函数及其化简
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-2.15 逻辑函数的机器化化简法
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-第二周--第二周作业
-3.0 门电路概述
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-3.1-1 半导体二极管的开关特性
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-3.1-2 二极管与门
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-3.1-3 二极管或门
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-3.1-4 二极管门电路的缺点
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-3.2-1 MOS管的基本构造和工作原理
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-3.2-2 MOS管的开关特性
--Video
-3.2-3 MOS管的工作特性曲线
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-3.3-1 CMOS反相器的电路结构和工作原理
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-3.3-2 CMOS反相器的电压电流传输特性
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-3.3-3 CMOS反相器的静态输入输出特性
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-3.3-4 CMOS反相器的动态特性
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-3.3-5 CMOS反相器的总功耗
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-第三周--第三周作业
-3.4-1 其他逻辑功能的CMOS门电路
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-3.4-2 带缓冲级的CMOS门电路
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-3.4-3 漏极开路的门电路
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-3.4-4 CMOS传输门和三态门
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-3.5-1-1 双极型三极管的输入输出特性
--Video
-3.5-1-2 双极型三极管的基本开关电路
--Video
-3.5-1-3 双极型三极管的开关等效电路、三极管反相器
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-第四周--第四周作业
-3.5-2-1 TTL反相器的电路结构
--Video
-3.5-2-2 TTL反相器的工作原理
--Video
-3.5-2-3 TTL反相器中的几个 问题和输入噪声容限
--Video
-3.5-3-1 TTL反相器的输入输出特性
--Video
-3.5-3-2 TTL反相器的输入端负载特性
--Video
-3.5-3-3 TTL反相器的扇出系数
--Video
-3.5-4-1 TTL反相器的传输延迟时间
--Video
-3.5-4-2 TTL反相器的交流噪声容限
--Video
-3.5-4-3 电源的动态尖峰电流
--Video
-3.5-5-1 其他逻辑功能的TTL门电路
--Video
-3.5-5-2 集电极开路输出的门电路
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-3.5-5-3 三态输出门
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-实验一：与非门电压传输特性曲线的观测
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-实验二：与非门传输延迟时间的测量
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-第五周--第五周作业
-4.1 组合逻辑电路的特点
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-4.2-1 组合逻辑电路的分析方法
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-4.2-2 组合逻辑电路的设计方法
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-4.3-1-1 若干常用组合逻辑电路：普通编码器
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-4.3-1-2-1 优先编码器
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-4.3-1-2-2 优先编码器的扩展
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-4.3-1-3 二-十进制优先编码器
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-4.3-2-1 译码器
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-4.3-2-2 二进制译码器的扩展
--Video
-4.3-2-3-1 显示译码器
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-4.3-2-3-2 显示译码器附加控制端的作用
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-4.3-2-4 用译码器设计组合逻辑电路
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-4.3-3-1 数据选择器
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-4.3-3-2 用数据选择器设计组合电路
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-4.3-4-1 加法器
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-4.3-4-2 多位加法器
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-4.3-4-3 用加法器设计组合电路
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-4.3-5 数值比较器
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-4.4-1_4.4-2 组合逻辑电路中的竞争-冒险现象
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-4.4-3 消除竞争-冒险现象的方法
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-第六周--第六周作业
-4.5 可编程器件及EDA1
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-5.0 触发器的由来
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-5.1 门电路与触发器的关系
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-5.2 基本RS锁存器
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-5.3-1 电平触发的SR触发器
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-5.3-2 电平触发的D触发器1
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-5.3-3 电平触发的D触发器2
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-5.4-1-1 脉冲触发的触发器--主从D触发器
--Video
-5.4-1-2 脉冲触发的触发器--主从SR触发器
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-5.4-1-3 脉冲触发的触发器--主从JK触发器
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-5.4-2 脉冲触发方式的动作特点
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-5.5 边沿触发的触发器
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-5.6-1 触发器的逻辑功能及其描述方法--SR触发器
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-5.6-2触发器的逻辑功能及其描述方法--JK触发器、T触发器、D触发器
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-第七周--第七周作业
-5.7-1 触发器的动态特性1
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-5.7-2 触发器的动态特性2
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-5.7-3 触发器的动态特性3
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-6.1-1 时序逻辑电路概述
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-6.1-2 时序电路的一般结构形式与功能描述方法
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-6.1.3 时序电路的分类
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-6.2.1-1 同步时序电路的分析方法1
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-6.2.1-2 同步时序电路的分析方法2
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-6.2.3 异步时序电路的分析方法
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-6.3.1-1 寄存器
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-6.3.1-2 移位寄存器1
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-6.3.1-3 移位寄存器2
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-6.3.1-4 移位寄存器扩展应用
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-6.3.2-1-1-1 计数器概述、同步二进制加法计数器
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-6.3.2-1-1-2 同步二进制减法计数器
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-6.3.2-1-1-3 同步加减计数器
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-6.3.2-1-2-1 同步十进制加法计数器
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-6.3.2-1-2-2 同步十进制减法计数器、十进制可逆计数器
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-6.3.2-2 异步计数器
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-第八周--第八周作业
-6.3.2-3-1-1 任意进制计数器的构成方法
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-6.3.2-3-1-2 任意进制计数器的构成方法--举例(N>M)
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-6.3.2-3-1-3 任意进制计数器的构成方法--举例(N<M)
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-6.3.2-4 计数器应用举例
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-6.4.1-1 时序逻辑电路的设计方法
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-6.4.1-2 时序逻辑电路的设计方法--举例
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-6.4.2 时序逻辑电路的动态特性分析
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-7.0 半导体存储器绪论
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-7.1 半导体存储器概述和分类
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-7.2-1 ROM的结构和工作原理
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-7.2-2 可编程ROM1
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-7.2-3 可编程ROM2
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-7.3 RAM的结构和工作原理
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-7.4-1 存储器容量的扩展-位扩展
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-7.4-2 存储器容量的扩展-字扩展
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-7.5 用存储器实现组合逻辑电路
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-第九周--第九周作业
-8.1 可编程逻辑器件概述
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-8.2-8.3-8.4 可编程逻辑器件-FPLA/PAL/GAL
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-8.5-8.6-8.7 可编程逻辑器件-EPLD/CPLD/FPGA
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-8.8-8.9 可编程逻辑器件-ISPGDS、PLD的使用
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-10.1-1 脉冲波形的产生和整形概述
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-10.1-2-10.2.1 门电路组成的施密特触发器
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-10.2.2 集成施密特触发器
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-10.2.3 施密特触发器的主要特点和应用
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-10.3.1-1-1 积分型单稳态触发器--结构和工作原理
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-10.3.1-1-2 积分型单稳态触发器--性能参数计算
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-10.3.1-2-1 微分型单稳态触发器--结构和工作原理
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-10.3.1-2-2 微分型单稳态触发器--性能参数计算
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-10.3.2 集成单稳态触发器
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-10.4.1 用施密特触发器构成的多谐振荡器
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-10.4.2 对称式多谐振荡器
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-10.4.3 非对称式多谐振荡器
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-第十周--第十周作业
-10.4.4 环形振荡器
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-10.4.5 石英晶体多谐振荡器
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-10.5 脉冲电路的分析方法
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-10.6.1 555定时器电路的结构与功能
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-10.6.2 用555定时器接成施密特触发器
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-10.6.3 用556定时器接成单稳态触发器
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-10.6.4 用557定时器接成多谐振荡器
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-11.1 数模和模数转换概述
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-11.2.1 权电阻网络D/A转换器
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-11.2.2 倒T型电阻网络D/A转换器
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-11.2.3 具有双极性输出的电阻网络D/A转换器
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-11.2.4 D/A转换器的转换精度和速度
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-11.3.1 A/D转换的基本原理
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-11.3.2 采样保持电路
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-11.3.3 并联比较型A/D转换器
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-11.3.4-1 反馈比较型A/D转换器--计数型
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-11.3.4-2 反馈比较型A/D转换器--逐次渐进型
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-11.3.5 双积分型和V-F型A/D转换器
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-第十一周--第十一周作业
-I-概述、电路设计及功能仿真
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-II-指定芯片及时序仿真
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-III-选外设（自动化）、锁定引脚并生成下载文件
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-IV-电路扩展设计
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-V-用Verilog描述状态机电路
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